Detect Rise Positive

Erkennen einer ansteigenden Flanke, wenn der Signalwert auf einen strikt positiven Wert steigt und der vorherige Wert nicht positiv war

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Bibliotheken:
Simulink / Logic and Bit Operations

Beschreibung

Der Block Detect Rise Positive erkennt eine ansteigende Flanke, indem er ermittelt, ob die Eingabe strikt positiv ist und der vorherige Wert nicht positiv war.

• Die Ausgabe ist wahr (gleich 1), wenn das Eingangssignal größer als null ist und der vorherige Wert kleiner gleich null war.

• Die Ausgabe ist falsch (gleich 0), wenn das Eingangssignal negativ oder null ist oder, bei einem positiven Eingangssignal, der vorherige Wert ebenfalls positiv war.

Dieser Block unterstützt nur diskrete Abtastzeiten.

Beispiele

Erkennen der ansteigenden Flanke von Signalen

Dieses Beispiel zeigt, wie Sie mithilfe der Blöcke „Detect Rise Nonnegative“ und „Detect Rise Positive“ die ansteigende Flanke eines Signals erkennen können.

Mit einer festen Schrittgröße von 0,25 veranschaulicht dieses Beispiel den Unterschied zwischen den Blöcken „Detect Rise Nonnegative“ und „Detect Rise Positive“. Der Block „Detect Rise Nonnegative“ gibt bei t=1 „Wahr“ (1) aus, da das Eingangssignal von einem negativen Wert auf einen nicht-negativen Wert (0) gestiegen ist. Der Block „Detect Rise Positive“ gibt bei t=1.25 „Wahr“ (1) aus, da das Eingangssignal von einem nicht-positiven Wert auf einen strikt positiven Wert (0) gestiegen ist.

Ports

Eingabe

Port_1 — Eingangssignal

Skalar | Vektor | Matrix

Das Eingangssignal, angegeben als Skalar, Vektor oder Matrix.

Datentypen: single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | Boolean | fixed point

Ausgabe

Port_1 — Ausgangssignal

Skalar | Vektor | Matrix

Ausgangssignal, das eine ansteigende Flanke erkennt, wenn die Eingabe strikt positiv ist und der vorherige Wert nicht positiv war. Die Ausgabe kann ein Skalar, ein Vektor oder eine Matrix sein.

• Die Ausgabe ist wahr (gleich 1), wenn das Eingangssignal größer als null ist und der vorherige Wert kleiner gleich null war.

• Die Ausgabe ist falsch (gleich 0), wenn das Eingangssignal negativ oder null ist oder, bei einem positiven Eingangssignal, der vorherige Wert ebenfalls positiv war.

Datentypen: uint8 | Boolean

Parameter

Initial condition — Anfangsbedingung des booleschen Ausdrucks U/z > 0

0 (Standardeinstellung) | Skalar | Vektor | Matrix

Legt die Anfangsbedingung des booleschen Ausdrucks U/z > 0 fest.

Programmatische Verwendung

Blockparameter: vinit

Typ: Zeichenvektor

Werte: Skalar | Vektor | Matrix

Standardwert: '0'

Input processing — Festlegen der abtast- oder blockbasierten Verarbeitung

Elements as channels (sample based) (Standardeinstellung) | Columns as channels (frame based)

Geben Sie an, ob der Block eine abtast- oder blockbasierte Verarbeitung durchführt:

• Columns as channels (frame based) – Behandelt jede Spalte der Eingabe als separaten Kanal (blockbasierte Verarbeitung).

  Hinweis

  Für die blockbasierte Verarbeitung ist eine DSP System Toolbox™-Lizenz erforderlich.

  Weitere Informationen finden Sie unter Sample- and Frame-Based Concepts (DSP System Toolbox).

• Elements as channels (sample based) – Behandelt jedes Element der Eingabe als separaten Kanal (abtastbasierte Verarbeitung).

Verwenden Sie Input processing, um anzugeben, ob der Block eine abtast- oder blockbasierte Verarbeitung durchführt. Weitere Informationen zu diesen beiden Verarbeitungsmodi finden Sie unter Sample- and Frame-Based Concepts (DSP System Toolbox).

Programmatische Verwendung

Blockparameter: InputProcessing

Typ: Zeichenvektor

Werte: 'Columns as channels (frame based)' | 'Elements as channels (sample based)'

Standardwert: 'Elements as channels (sample based)'

Output data type — Ausgangs-Datentyp

boolean (Standardeinstellung) | uint8

Legt den Ausgangs-Datentyp als boolean oder uint8 fest.

Programmatische Verwendung

Blockparameter: OutDataTypeStr

Typ: Zeichenvektor

Werte: 'boolean' | 'uint8'

Standardwert: 'boolean'

Blockeigenschaften

Datentypen	Boolean | double | fixed point | integer | single
Direct Feedthrough	ja
Mehrdimensionale Signale	ja
Signale mit variabler Größe	ja
Erkennung von Nulldurchgängen	nein

Erweiterte Fähigkeiten

C/C++ Codegenerierung

Generieren von C und C++ Code mit Simulink® Coder™.

Der generierte Code basiert unter bestimmten Bedingungen auf memcpy- oder memset-Funktionen (string.h).

HDL-Codegenerierung

Generieren von VHDL, Verilog und SystemVerilog Code für FPGA- und ASIC-Designs mit HDL Coder™.

HDL Coder™ bietet weitere Konfigurationsoptionen, die sich auf die HDL-Implementierung und synthetisierte Logik auswirken.

HDL-Architektur

Dieser Block weist eine Standard-HDL-Architektur auf.

HDL-Blockeigenschaften

ConstrainedOutputPipeline	Anzahl Register, die durch Verschiebung bestehender Verzögerungen im Design an den Ausgängen platziert werden sollen. Bei verteiltem Pipelining werden diese Register nicht neu verteilt. Der Standardwert ist 0. Weitere Informationen finden Sie unter ConstrainedOutputPipeline (HDL Coder).
InputPipeline	Anzahl der Eingangs-Pipeline-Phasen, die in den generierten Code eingefügt werden sollen. Verteiltes Pipelining und beschränktes Ausgangs-Pipelining kann diese Register verschieben. Der Standardwert ist 0. Weitere Informationen finden Sie unter InputPipeline (HDL Coder).
OutputPipeline	Anzahl der Ausgangs-Pipeline-Phasen, die in den generierten Code eingefügt werden sollen. Verteiltes Pipelining und beschränktes Ausgangs-Pipelining kann diese Register verschieben. Der Standardwert ist 0. Weitere Informationen finden Sie unter OutputPipeline (HDL Coder).

PLC-Codegenerierung
Generieren strukturierten Textcodes mit Simulink® PLC Coder™.

Festkommakonvertierung
Entwerfen und Simulieren von Festkommasystemen mit Fixed-Point Designer™.

Versionsverlauf

Eingeführt vor R2006a

Siehe auch

Detect Change | Detect Decrease | Detect Fall Negative | Detect Fall Nonpositive | Detect Increase | Detect Rise Nonnegative